It would be interesting to compare the findings with what Wolfgang Moser found out:
http://www.zimmers.net/anonftp…CSG8726TechRefDoc-1.0.zip
Don't hold back... 
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letzter Beitrag von androSID am
REU Controller 8726R1 dissection...
- androSID
- Erledigt
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It would be interesting to compare the findings with what Wolfgang Moser found out:
http://www.zimmers.net/anonftp…CSG8726TechRefDoc-1.0.zipDon't hold back...
Na ja, wie ich jetzt erst gesehen habe ist der wirklich spannende Teil '31) tapeworm from hell, also known as "the control circuitry"' zwar rekonstruiert, aber nicht analysiert.
Schade.
Darin dürften sich die meisten von WoMo beschriebenen "Macken", "komischen Effekte" u.ä. verstecken.
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Na ja, wie ich jetzt erst gesehen habe ist der wirklich spannende Teil '31) tapeworm from hell, also known as "the control circuitry"' zwar rekonstruiert, aber nicht analysiert.
Bin gerade dabei...
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Hab min 60 verschiedene cpu, sic, vic, cia, rom, ted, mem. Controller, pla usw in mehr als ausreichenden Stückzahlen am lager... sag mir welche du zerlegen willst, dann guck ich gern nach was ich hab und schick dir was
Sorry fürs offtopicBG Ronny
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Hab min 60 verschiedene cpu, sic, vic, cia, rom, ted, mem. Controller, pla usw in mehr als ausreichenden Stückzahlen am lager... sag mir welche du zerlegen willst, dann guck ich gern nach was ich hab und schick dir was
Sorry fürs offtopicBG Ronny
Einen SIC würde ich mir anschauen...
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Hab min 60 verschiedene cpu, sic, vic, cia, rom, ted, mem. Controller, pla usw in mehr als ausreichenden Stückzahlen am lager... sag mir welche du zerlegen willst, dann guck ich gern nach was ich hab und schick dir was
Sorry fürs offtopicBG Ronny
Einen SIC würde ich mir anschauen...
sag mir bitte welchen genau, dann gibts demnächst vorweihnachtspäckchen 🤣
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Bis ich wir die alle "dissected" haben vergeht noch einiges an Zeit:
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Bis ich wir die alle "dissected" haben vergeht noch einiges an Zeit:
ok ichgleich mal meinen bestand ab und schick dir pm was ich dir zukommen lassen kann.
Bg Ronny
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Wirklich klasse.
Woher nimmst Du die Zeit, das alles zu machen? Das würde mich wirklich mal interessieren. Danke auch für die Bereitstellung aller Informationen. -
Wirklich klasse.
Woher nimmst Du die Zeit, das alles zu machen? Das würde mich wirklich mal interessieren. Danke auch für die Bereitstellung aller Informationen.Die Zeit habe ich ja eignetlich gar nicht. Aber dank' der hilfe von ttlworks geht's dann doch irgendwie...
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Bis ich wir die alle "dissected" haben vergeht noch einiges an Zeit: (...)
Du "Wahnsinniger"...
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Das "Problem" sind eher die hohen Laborkosten fürs decappen und fotografieren.
Der Rest ist nur einfach Freizeit.
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Apologies for bringing back this old thread, but has anyone taken what was learned here and thought to implement it into an FPGA recreation?
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Apologies for bringing back this old thread, but has anyone taken what was learned here and thought to implement it into an FPGA recreation?
Yes. I did - but it's "unpolished". In other words: It's working perfectly but cannot be used as a product with an perfect OOB experience yet. I need to port it to a different FPGA because MAX10 (which I prefer for development) is too expensive for mass products IMHO.
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Apologies for bringing back this old thread, but has anyone taken what was learned here and thought to implement it into an FPGA recreation?
Yes. I did - but it's "unpolished". In other words: It's working perfectly but cannot be used as a product with an perfect OOB experience yet. I need to port it to a different FPGA because MAX10 (which I prefer for development) is too expensive for mass products IMHO.
So can you post your 'work in progress?' Maybe a Github site? I had just started looking into doing the same. Have a Max II and a Cyclone II that I was planning on working with - both are really cheap and available. Was hoping to create something that could be a drop-in replacement so boards that had a burnt-out 8726 could be reused, and maybe some extra features to be able to use an SSD or something.
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Yes. I did - but it's "unpolished". In other words: It's working perfectly but cannot be used as a product with an perfect OOB experience yet. I need to port it to a different FPGA because MAX10 (which I prefer for development) is too expensive for mass products IMHO.
So can you post your 'work in progress?'
No. I don't have any plans to publish any work or disclose the bugs I found in the dissection while converting it to Verilog.
